FPGA를 활용하여 설계를 하기 위한 툴 중 하나로 Vivado가 있다. Vivado는 Xilinx에서 개발한 FPGA 설계 도구로 Xilinx 사의 FPGA로 사용할 수 있다. 또한 Vivado를 통하여 HDL 제작, 시뮬레이션, 합성 등 설계의 과정을 전부 진행할 수 있다. Vivado에서 사용가능한 언어는 Verilog와 VHDL 등이 있으며 하드웨어 설계에 깊이 사용되는 언어들이다. 그중에서 Verilog 문법을 살펴보고자 한다. Verilog는 회로 모듈 단위로 코딩을 한다. 디지털 회로는 모듈의 집합으로 이루어져 있으며 모듈들의 계층적 구조로 이루어져있다. 하나의 모듈은 module 모듈명 (input, output port 들); input ~; output ~; assign ~ = ~; e..
